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SAR数据存储系统的设计与实现

作　者: 马宇
导　师: 黎向阳
学　校: 国防科学技术大学
专　业: 信息与通信工程
关键词: SAR FLASH FPGA DSP 并行操作总线流水
分类号: TN958
类　型: 硕士论文
年　份: 2010年
下　载: 61次
引　用: 1次
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内容摘要

SAR是一种通过发射宽带信号,以获取高的距离分辨力,采用合成孔径获取高的方位分辨力,从而在二维平面上对照射目标或区域进行成像的雷达体制。SAR在运行过程中会产生大量的采样数据。因此,SAR系统必须具备一个高速的数据存储器,能够将这些采样数据实时的保存下来。本文设计实现了一种针对机载SAR应用的数据存储系统。在系统方案设计中,采用单片容量为4 G×8 bit的大容量NAND FLASH芯片作为存储载体,在存储操作上采用了“并行操作”和“总线流水”的方法,大大提高了存储系统的数据率。此外,在设计中还增加了多个接口,使本系统除了能够与雷达的信号处理系统交换数据外,还可以在硬件上直接存储来自A/D采集板的数据,或者将存储的数据送往D/A板进行回放。具体实现上,采用FPGA作为整个系统的核心控制器件,实现对NAND FLASH的读写;采用DSP芯片作为连接信号处理系统的高速接口。文章最后,对FLASH芯片的读写操作和“总线流水”方法在FPGA内部实现的结果进行了测试。在设计和实现的过程中不仅明显提高了系统的数据容量和存储速率,还增强了通用性,使系统的应用范围得到了拓展,使用更加灵活。

全文目录

摘要  9-10
ABSTRACT  10-11
第一章绪论  11-16
  1.1 研究背景及意义  11-12
  1.2 发展概况  12-15
  1.3 本文的主要工作  15-16
    1.3.1 主要研究内容及思路  15
    1.3.2 各章节内容安排  15-16
第二章系统功能设计  16-42
  2.1 系统的应用背景  16-18
  2.2 基本性能指标分析  18-19
  2.3 总体方案设计  19-22
    2.3.1 总体设计  19-21
    2.3.2 器件选择  21-22
  2.4 系统功能设计  22-40
    2.4.1 数据存储  22-27
    2.4.2 数据读取  27-28
    2.4.3 存储的可靠性  28-33
    2.4.4 系统接口  33-36
    2.4.5 控制核心  36-40
  2.5 系统的工作模式  40-41
  2.6 本章小结  41-42
第三章存储系统工程实现  42-52
  3.1 FLASH 芯片组的驱动电路  42-43
  3.2 “坐标标记”方法的实现  43-45
  3.3 ECC 算法的实现  45-46
  3.4 FLASH 访问操作的实现  46-49
  3.5 “总线流水”方法的实现  49-50
  3.6 本章小结  50-52
第四章存储系统指标测试  52-65
  4.1 FLASH 操作时序波形的测试  53-62
    4.1.1 锁存循环时序测试  53-56
    4.1.2 基本操作时序测试  56-62
  4.2 FLASH 存储区数据写入测试  62-64
  4.3 本章小结  64-65
结束语  65-66
致谢  66-67
参考文献  67-69
作者在学期间取得的学术成果  69

SAR数据存储系统的设计与实现

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