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FPGA芯片TILE单元建模以及故障覆盖率分析

作　者: 徐文丰
导　师: 来金梅；郭亚炜
学　校: 复旦大学
专　业: 集成电路工程
关键词: FPGA 建模故障覆盖率 TurboFault
分类号: TN402
类　型: 硕士论文
年　份: 2011年
下　载: 44次
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内容摘要

FPGA是目前运用广泛的一种可编程逻辑器件,FPGA的出现填补了ASIC在设计成本,设计周期上的缺陷。FPGA主要分为三个部分：逻辑资源结构、互连资源结构以及编程配置。本文针对FPGA芯片,进行了逻辑资源、互联资源基本单元TILE的建模工作,设计了TILE基本单元功能仿真模型,并且完成了TILE单元互连模型的简化设计流程以及功能单元编程点配置流程,完成了TILE单元功能仿真以及验证。此外,本文采用TurboFault软件,对针对TILE单元中负责逻辑功能配置的SLICE单元所设计的一组遍历测试pattern进行了故障覆盖率的测试。最终,本文得到了各个测试pattern的故障覆盖报告,并且通过对测试pattern故障覆盖率报告的分析整理得到了整体故障覆盖率,发现了一些原来没有覆盖到的故障,并通过设计新的测试pattern完成了这些故障的覆盖。为了更好地完成TILE单元的建模、仿真过程,本文在设计过程中提出了一些逻辑资源模块的建模思路以及对互连模块简化建模的一种创新的方法,并且为TILE单元仿真过程中功能单元编程点配置这一问题设计了一个从配置文件直接生成编程点配置信息的解决办法。最终本文设计了完成这些过程的脚本,实现了从测试pattern提供的配置文件得到TILE单元功能仿真模型以及编程点配置文件,不仅帮助完成了这组测试pattern故障覆盖率测试工作,也为整体FPGA芯片功能仿真的实现提供了部分软件以及方法的基础。最终,本文经过对现有测试pattern的分析,总结了将一个TILE单元作为仿真测试模型的情况下两个SLICE单元没有覆盖到的故障以及原因,并且针对单个SLICE单元补充设计了新的测试pattern,将SLICE单元测试pattern的故障覆盖率提高到了93.4%,通过数据定量地评估了测试pattern的有效性。

全文目录

图片目录  3-5
图表目录  5-6
摘要  6-7
Abstract  7-9
第一章引言  9-11
  1.1 FPGA概述  9
  1.2 TurboFault软件概述  9
  1.3 工作重点  9-11
第二章研究背景  11-22
  2.1 FPGA通用结构  11-17
    2.1.1 可编程逻辑单元结构  12-14
    2.1.2 互连资源结构  14-16
    2.1.3 编程配置资源  16-17
  2.2 软件流程  17-21
    2.2.1 软件功能  17
    2.2.2 软件流程  17-19
    2.2.3 逻辑仿真以及故障覆盖率测试  19-21
  2.3 本章小结  21-22
第三章设计流程  22-52
  3.1 测试芯片模型建立与仿真  22-37
    3.1.1 逻辑资源结构建模  23-31
    3.1.2 TILE内部互连资源结构建模  31-35
    3.1.3 逻辑配置方法设计  35-37
  3.2 测试pattern介绍  37-40
  3.3 测试流程  40-41
  3.4 模型仿真  41-51
  3.5 本章小结  51-52
第四章测试覆盖率报告  52-65
  4.1 故障归并  52-56
  4.2 TILE单元故障覆盖率  56-58
  4.3 SLICE单元测试pattern补充以及故障覆盖率  58-62
  4.4 设计不足以及后续展望  62-64
  4.5 本章小结  64-65
第五章设计总结  65-67
  5.1 主要工作  65-66
  5.2 创新点  66
  5.3 设计总结  66-67
参考文献  67-69
致谢  69-70

FPGA芯片TILE单元建模以及故障覆盖率分析

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