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应用于OFDM UWB系统的高速分频器研究与设计

作　者: 尹江伟
导　师: 李宁
学　校: 复旦大学
专　业: 微电子学与固体电子学
关键词: 超宽带 频率综合器 分频器 注入锁定
分类号: TN772
类　型: 硕士论文
年　份: 2009年
下　载: 176次
引　用: 1次
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内容摘要


在短距离高速无线通信领域,超宽带(Ultra-wideband,UWB)技术以其高达百Mbps的传输速率吸引了工业界及学术界的广泛关注和积极研究。作为当前超宽带技术的主流标准,基于多边带频分复用(MultiBand Orthogonal Frequency DivisionMultiplexing,MB-OFDM)的技术方案将整个超宽带3.1-10.6GHz的频谱划分为14个间隔为528MHz的子边带,并通过频率综合器来产生各边带间切换所需的载波信号。在基于锁相环的频率综合器中,分频器是其中一个非常关键的模块。尤其是工作在最高频率的第一级分频器,其所消耗的功耗也占整个综合器功耗的较大比例。而且,随着分频器工作频率的上升,其所消耗的功耗也急剧增加。设计一个高速低功耗的分频器依旧是射频集成电路领域的一件有挑战性的工作。本文主要研究的内容为应用于超宽带频率综合器系统的高速分频器。本文首先全面的总结和比较了当前各种分频器结构的分频原理,性能优缺点及各自的电路实现。这些结构包括双模,多模,分数分频等数字分频器及再生型,注入锁定型和源级耦合型的模拟分频器。其次,对于应用于UWB“模式一”系统的频率综合器,根据各种分频器的结构特点,本文采用Jazz 0.18-um RF CMOS工艺设计了一个分频比为176的分频器链路。该链路包括了四级的源级耦合二分频器,一级TSPC数字二分频器和一级11分频的异步分频器,整个链路实现了从4.224GHz的射频信号到24MHz数字信号的分频。在1.8V电源电压下,整个分频器链路的功耗为9.5mA。测试结果表明,该链路能稳定的为频率综合器实现分频功能,这为频率综合器的锁定奠定了重要基础。最后,对于UWB的高频段应用,本文采用Jazz 0.18-um RF CMOS工艺设计了一个注入锁定型的二分频器。通过对注入方式的创新改进及对传统调谐方法的应用,该注入锁定分频器实现了锁定范围这一重要性能指标的突破,在较低的功耗下实现了较大的频率锁定范围(6.23-11.08GHz)。在1.8V的电源电压下,该分频器核心电路功耗为3.7mA。较大的锁定频率范围以及较低的电源功耗特性为该注入锁定分频器在超宽带系统高频段部分中的应用带来了广阔的前景。

全文目录


摘要  3-4
ABSTRACT  4-7
第1章 绪论  7-12
  1.1 论文研究背景  7-10
  1.2 论文的主要工作和贡献  10-11
  1.3 论文的组织安排  11-12
第2章 超宽带系统中的频率综合器  12-25
  2.1 本章概要  12
  2.2 频率综合器简介  12-16
    2.2.1 整数N分频频率综合器  13-14
    2.2.2 分数N分频频率综合器  14-15
    2.2.3 双环路频率综合器  15-16
  2.3 频率综合器系统的模块介绍  16-23
    2.3.1 鉴频鉴相器/电荷泵  16-18
    2.3.2 环路滤波器  18-19
    2.3.3 压控振荡器  19-22
    2.3.4 分频器  22-23
  2.4 UWB系统中的频率综合器结构  23-25
第3章 分频器结构分析  25-40
  3.1 本章概要  25
  3.2 数字分频器  25-33
    3.2.1 双模数字分频器  25-27
    3.2.2 多模数字分频器  27-30
    3.2.3 分数分频器  30-32
    3.2.4 数字二分频器  32-33
  3.3 模拟分频器  33-40
    3.3.1 再生型分频器  33-34
    3.3.2 注入锁定分频器  34-37
    3.3.3 源级耦合分频器  37-40
第4章 超宽带系统中的分频器链路设计  40-55
  4.1 本章摘要  40
  4.2 分频器链路架构  40-41
  4.3 分频器结构选择  41
  4.4 分频器设计指标  41-42
  4.5 源级耦合(SCL)二分频器  42-49
    4.5.1 动态特性  42-43
    4.5.2 电路参数设计  43-46
    4.5.3 主要设计考虑  46-48
    4.5.4 仿真数据与结果  48-49
  4.6 数字分频器  49-55
    4.6.1 TSPC数字二分频器的设计  50-53
    4.6.2 异步11分频器  53-55
第5章 应用于超宽带系统的注入锁定分频器设计  55-68
  5.1 本章概要  55
  5.2 注入锁定  55-58
    5.2.1 Adler的研究基础  55-57
    5.2.2 注入锁定工作原理  57-58
  5.3 注入锁定分频器  58-61
  5.4 设计实例  61-68
    5.4.1 主要创新点  61-62
    5.4.2 总体电路设计  62-66
    5.4.3 电路版图布局  66-67
    5.4.4 电路性能仿真  67-68
第6章 芯片测试及结果  68-78
  6.1 本章概要  68
  6.2 SCL分频器链路测试  68-72
  6.3 注入锁定分频器测试  72-78
    6.3.1 自激振荡频率测试  73
    6.3.2 分频器锁定性能测试  73-76
    6.3.3 分频器相位噪声性能测试  76-78
第7章 总结与展望  78-79
第8章 参考文献  79-83
第9章 致谢  83-84
攻读学位期间取得的研究成果  84-85

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中图分类: > 工业技术 > 无线电电子学、电信技术 > 基本电子电路 > 倍频器、分频器、变频器 > 分频器
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